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Cover: 9783486580044 | Verilog | Modellbildung für Synthese und Verifikation | Bernhard Hoppe
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Verilog
Modellbildung für Synthese und Verifikation
Buch von Bernhard Hoppe
Sprache: Deutsch

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Kategorien:
Beschreibung
Verilog ist die neben VHDL am weitesten verbreitete Hardware-Beschreibungssprache (HDL) für den Entwurf und die Beschreibung elektronischer Schaltkreise und Systeme. Gegenüber VHDL bietet Verilog vor allem den Vorteil der leichteren Erlernbarkeit, da es auf der im Ingenieurbereich weit verbreiteten Sprache C aufgebaut ist. Das Buch von Bernhard Hoppe vermittelt alle relevanten Grundlagen und Anwendungsmöglichkeiten von Verilog und ermöglicht so einen schnellen Einstieg und Überblick. Es ist konzipiert als Lehrbuch für Studierende der Elektrotechnik im Hauptstudium, eignet sich aber auch zum Selbststudium für Berufspraktiker und andere Interessierte. Jedes Kapitel enthält Übungsaufgaben mit Lösungen; dem Buch ist eine CD mit Powerpoint-Folien für den Unterricht, einer Laboranleitung mit Zugang zu der XILINX Studentenversion für den Simulator MODELSIM und Quellcodes beigelegt.
Verilog ist die neben VHDL am weitesten verbreitete Hardware-Beschreibungssprache (HDL) für den Entwurf und die Beschreibung elektronischer Schaltkreise und Systeme. Gegenüber VHDL bietet Verilog vor allem den Vorteil der leichteren Erlernbarkeit, da es auf der im Ingenieurbereich weit verbreiteten Sprache C aufgebaut ist. Das Buch von Bernhard Hoppe vermittelt alle relevanten Grundlagen und Anwendungsmöglichkeiten von Verilog und ermöglicht so einen schnellen Einstieg und Überblick. Es ist konzipiert als Lehrbuch für Studierende der Elektrotechnik im Hauptstudium, eignet sich aber auch zum Selbststudium für Berufspraktiker und andere Interessierte. Jedes Kapitel enthält Übungsaufgaben mit Lösungen; dem Buch ist eine CD mit Powerpoint-Folien für den Unterricht, einer Laboranleitung mit Zugang zu der XILINX Studentenversion für den Simulator MODELSIM und Quellcodes beigelegt.
Über den Autor
Prof. Dr. Bernhard Hoppe arbeitete von 1986-1989 bei den Siemens Forschungslaboratorien in München und anschließend für vier Jahre am IC-Design-Zentrum der VDO Adolf Schindling. Seit 1993 ist er Professor für Elektrotechnik an der FH Darmstadt und dort seit 2002 Leiter des internationalen Studiengangs "Master of Science in Electrical Engineering".
Zusammenfassung
Nicht-exklusives Verkaufsrecht für: Gesamte Welt.
Inhaltsverzeichnis
- Einführung: Geschichte der Sprache; Was sind HDLs; Vergleich Verilog/VHDL; Normung der Sprache durch IEEE als Verilog 2001 - Designmethoden für digitale Schaltungen; Implementierungstechniken (ASIC, FPGA etc.) - Verilog-Grundlagen: Primitive, Datentypen, Operatoren - Aufbau von Verilog-Modellen - Simulation von Schaltungsmodellen in Verilog, Signalgeneratoren und Testbenches - Strukturelle Modelle und Hierarchien - Verhaltensmodellierung mit Verilog - Zustandsautomaten und Datenpfadmodelle - Designbeispiele - Vergleich Verilog/VHDL - Cosimulation von gemischten Verilog/VHDL-Modellen - Anhänge
Details
Erscheinungsjahr: 2006
Fachbereich: Nachrichtentechnik
Genre: Mathematik, Medizin, Naturwissenschaften, Technik
Rubrik: Naturwissenschaften & Technik
Medium: Buch
Inhalt: XIII
289 S.
ISBN-13: 9783486580044
ISBN-10: 3486580043
Sprache: Deutsch
Einband: Gebunden
Autor: Hoppe, Bernhard
Auflage: 1. Auflage
Hersteller: De Gruyter Oldenbourg
Verantwortliche Person für die EU: Walter de Gruyter GmbH, De Gruyter GmbH, Genthiner Str. 13, D-10785 Berlin, productsafety@degruyterbrill.com
Maße: 246 x 175 x 22 mm
Von/Mit: Bernhard Hoppe
Erscheinungsdatum: 20.09.2006
Gewicht: 0,698 kg
Artikel-ID: 102161193
Über den Autor
Prof. Dr. Bernhard Hoppe arbeitete von 1986-1989 bei den Siemens Forschungslaboratorien in München und anschließend für vier Jahre am IC-Design-Zentrum der VDO Adolf Schindling. Seit 1993 ist er Professor für Elektrotechnik an der FH Darmstadt und dort seit 2002 Leiter des internationalen Studiengangs "Master of Science in Electrical Engineering".
Zusammenfassung
Nicht-exklusives Verkaufsrecht für: Gesamte Welt.
Inhaltsverzeichnis
- Einführung: Geschichte der Sprache; Was sind HDLs; Vergleich Verilog/VHDL; Normung der Sprache durch IEEE als Verilog 2001 - Designmethoden für digitale Schaltungen; Implementierungstechniken (ASIC, FPGA etc.) - Verilog-Grundlagen: Primitive, Datentypen, Operatoren - Aufbau von Verilog-Modellen - Simulation von Schaltungsmodellen in Verilog, Signalgeneratoren und Testbenches - Strukturelle Modelle und Hierarchien - Verhaltensmodellierung mit Verilog - Zustandsautomaten und Datenpfadmodelle - Designbeispiele - Vergleich Verilog/VHDL - Cosimulation von gemischten Verilog/VHDL-Modellen - Anhänge
Details
Erscheinungsjahr: 2006
Fachbereich: Nachrichtentechnik
Genre: Mathematik, Medizin, Naturwissenschaften, Technik
Rubrik: Naturwissenschaften & Technik
Medium: Buch
Inhalt: XIII
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ISBN-13: 9783486580044
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Einband: Gebunden
Autor: Hoppe, Bernhard
Auflage: 1. Auflage
Hersteller: De Gruyter Oldenbourg
Verantwortliche Person für die EU: Walter de Gruyter GmbH, De Gruyter GmbH, Genthiner Str. 13, D-10785 Berlin, productsafety@degruyterbrill.com
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Von/Mit: Bernhard Hoppe
Erscheinungsdatum: 20.09.2006
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